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搜索结果: 1-9 共查到知识库 工学 FIFO相关记录9条 . 查询时间(0.156 秒)
针对FPGA 资源紧张和数据在不同时钟域间传递的亚稳态问题,设计一种基于FPGA+DSP 架构的异步 FIFO 视频图像数据采集方法。在IIC 配置模块和解交织模块的作用下,通过在2 个时钟域的交界处设计3 个低深度 异步FIFO 方式实现视频数据流的传输,由发送时钟域将数据写入,接收时钟域将数据读出,在数据传输的同时实现 数据的缓存;通过分析FPGA 芯片内资源利用情况并进行系统测试,结果表明:...
针对FPGA资源紧张和数据在不同时钟域间传递的亚稳态问题,设计一种基于FPGA+DSP架构的异步FIFO视频图像数据采集方法。在IIC配置模块和解交织模块的作用下,通过在2个时钟域的交界处设计3个低深度异步FIFO方式实现视频数据流的传输,由发送时钟域将数据写入,接收时钟域将数据读出,在数据传输的同时实现数据的缓存;通过分析FPGA片内资源利用情况并进行系统测试,结果表明:系统能够准确地再现输入的...
Part 1: In this the main objective of the project was to produce a VHDL design which can be programmed on Altera DE2 board. This project gives an overview of how different components of DE2 board can ...
在跨时钟域传递数据的系统中,常采用异步FIFOFirst In First Out,先进先出队列)口来缓冲传输的数据,以克服亚稳态产生的错误,保证数据的正确传输。但由于常规异步FIFO模块中的RAM存储器读写寻址指针常采用格雷码计数器以及“空满”控制逻辑的存在,将使通过这两个模块的信号通路延时对整个模块的工作频率造成制约。提出了一种在FPGA内实现高速异步FIFO的方法,该方法针对不可能产生满信...
目前在拥有多遥感器的遥感卫星数据传输与处理系统中关于FIFO容量的计算还没有一种准确的计算方法。针对专用星载高速数据传输总线结构的数据传输过程,推导出了计算FIFO中可能达到的最大数据量的一种算法,为FIFO的容量选取提供了理论计算依据。仿真结果表明,推导出的计算公式对FIFO容量选取有很强的工程指导意义。与目前凭经验选取FIFO容量的方法相比,可以有效地节省芯片的存储资源。
基于FIFO的DDC与DSP高速数据传输实现     FIFO  DDC  DSP       2009/8/4
基于DDC和DSP的软件无线电中频信号处理方案。详细阐述了利用FIFO实现的DDC与DSP间数据传输的电路结构;分析了数据传输方式,FIFO数据的读写时序以及DSP EMIF的具体设置;根据硬件结构特点提出了设计中需要注意的问题。
一种节能型可升级异步FIFO的FPGA实现     FIFO  FPGA  IP核       2009/8/4
提出了一种节能并可升级的异步FIFO的FPGA实现。此系统结构利用FPGA内自身的资源控制时钟的暂停与恢复,实现了高能效、高工作频率的数据传输。该系统在Xilinx的VC4VSX55芯片中实现,实际可工作于高达100/153.6 MHz的读/写时钟域。本文所提出的结构不依赖于现有的IP核,基于此结构易建立可升级的IP核。
使用先入先出(FIFO)循环缓冲区方案解决实时系统中数字信号处理(DSP)外围设备调度问题.解析证明了循环缓冲区可调度的充要条件是外围设备总响应时间占总时间的比率小于1,并对数据帧周期输入到外围设备的情况,提出一种求解开辟缓冲区最小空间的离线数值计算方法.该方法应用于某高端导航接收机DSP外围设备调度设计,可以快速求出缓冲区所需开辟的最小空间.
介绍异步FIFO存储器应用及其结构,详细分析了异步FIFO的标志逻辑设计及亚稳态的消除,提出了一种基于FPGA芯片利用格雷码对地址编码解决异步读、写时钟问题的思路及方法,并给出了VHDL程序.该方法具有高速、可移植性强、工作效率高的特点,在数字系统设计中具有一定的意义和应用价值.

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